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隨著我國改革開放，人們生活水平的不斷提高，汽車越來越成為人們生活中不可缺少的一部分。從世界上第輛T型福特牌轎車被盜開始，偷車已成為現(xiàn)今城市里最常見的犯罪行為之一。汽車數(shù)量增多，車輛被盜的數(shù)量也逐年上升，這給社會帶來極大的不安定因素，擔心車輛被盜，成為困擾每一位汽車用戶的難題。 　　本文將系統(tǒng)介紹有關(guān)汽車防盜器的原理、選配、安裝及使用等方面的基本知識，希望能給放大汽車用戶以幫助。歡迎廣大讀者和業(yè)內(nèi)士來稿或咨詢，協(xié)助我們將此欄目辦好。 　　問：什么是汽車防盜器？ 　　答：簡單說，汽車防盜器就是一種安裝在車上，用來增加盜車難度，處長盜車時間的裝置。 　　問：汽車防盜器有哪幾種類型？ 　　答：隨著科學(xué)技術(shù)的進步，為對付不斷升級的盜車手段，人們一代一代研制各種方式、不同結(jié)構(gòu)的防盜器，目前防盜器按其結(jié)構(gòu)可分三大類；機械式、電子式和網(wǎng)絡(luò)式。鉤鎖、轉(zhuǎn)達向盤鎖和變速擋鎖等基本屬于機械式防盜器，它主要是告鎖定離合、制動、油門或轉(zhuǎn)向盤、變速擋來達到防盜的目的，但只防盜不報警。插片式、按鍵式和遙控式等都屬于電子式防盜器，（摘自：華夏汽車影音防盜社區(qū)http://bbs.carbav.com)它主要是靠鎖定點火或起動來達到防盜的目的，同時具有防盜和聲音報警功能。GPS衛(wèi)星定位汽車防盜系統(tǒng)(或其他網(wǎng)絡(luò)系統(tǒng))，將報警信息和報警車輛所在位置無聲地傳送到報警中心。 　　問：遙控式汽車防盜器有哪些特點？　　答：遙控式汽車防盜器是隨著電子技術(shù)的進步而發(fā)展起來的，是市場上推廣普及最為廣泛的一種。它的特點是遙控控制防盜器的全部功能，可靠方便，可帶有振動偵測、門控保護及微波或紅外探頭等功能。隨著市對防盜器要求的不斷提高，遙控式汽車防盜器還增加了許多方便使用的附加功能，如遙控中控門鎖、遙控送放冷暖風、遙控電動門窗及遙控開啟行李艙等功能。

本帖最后由 eehome 于 2013-1-5 10:07 編輯 　　1、 什么是同步邏輯和異步邏輯? 整個設(shè)計中只有一個全局時鐘稱為同步邏輯。 同步電路是由時序電路(寄存器和各種觸發(fā)器) 和組合邏輯電路構(gòu)成的電路， 其所有操作都是在嚴格的時鐘控制下完成的。 這些時序電路共 享同一個時鐘CLK，而所有的狀態(tài)變化都是在時鐘的上升沿(或下降沿)完成的。 不同子系統(tǒng)使用多個時鐘信號的邏輯設(shè)計稱為異步邏輯?！　?、 什么是競爭與冒險現(xiàn)象?怎樣判斷?如何消除? 信號在數(shù)字電路器件內(nèi)部通過連線和邏輯單元時， 都有一定的延時。 延時的大小與連線的長 短和邏輯單元的數(shù)目有關(guān)，同時還受器件的制造工藝、工作電壓、溫度等條件的影響。信號 的高低電平轉(zhuǎn)換也需要一定的過渡時間。 由于存在這兩方面因素， 多路信號的電平值發(fā)生變 化時，在信號變化的瞬間，組合邏輯的輸出有先后順序，并不是同時變化，往往會出現(xiàn)一些 不正確的尖峰信號，這些尖峰信號稱為"毛刺"。如果一個組合邏輯電路中有"毛刺"出現(xiàn)，就 說明該電路存在"冒險"。 解決方法：一是添加布爾式的消去項，二是用 D 觸發(fā)器，格雷碼計數(shù)器，同步電路等優(yōu)秀的 設(shè)計方案可以消除?！　?、什么是亞穩(wěn)態(tài)?如何解決亞穩(wěn)態(tài)? 亞穩(wěn)態(tài)是指觸發(fā)器無法在某個規(guī)定時間段內(nèi)達到一個可確認的狀態(tài)。 當一個觸發(fā)器進入亞穩(wěn) 態(tài)時，既無法預(yù)測該單元的輸出電平，也無法預(yù)測何時輸出才能穩(wěn)定在某個正確的電平上。 在這個穩(wěn)定期間，觸發(fā)器輸出一些中間級電平，或者可能處于振蕩狀態(tài)，并且這種無用的輸 出電平可以沿信號通道上的各個觸發(fā)器級聯(lián)式傳播下去。 解決方法： 1) 降低系統(tǒng)時鐘 2) 用反應(yīng)更快的 FF 3) 引入同步機制，防止亞穩(wěn)態(tài)傳播 4) 改善時鐘質(zhì)量，用邊沿變化快速的時鐘信號，關(guān)鍵是器件使用比較好的工藝和時鐘周期 的裕量要大?！　?、常用邏輯電平有哪些?TTL 與 COMS 電平可以直接互連嗎? TTL，COMS，不能直連 LVDS：LVDS(Low Voltage Differential Signal)即低電壓差分信號，LVDS 接口又稱 RS644 總線接口，是 20 世紀 90 年代才出現(xiàn)的一種數(shù)據(jù)傳輸和接口術(shù)。 ECL：(EmitterCoupled Logic)即射極耦合邏輯，是帶有射隨輸出結(jié)構(gòu)的典型輸入輸出接口 電路。 CML：CML 電平是所有高速數(shù)據(jù)接口中最簡單的一種。其輸入和輸出是匹配好的，減少了外 圍器件，適合于更高頻段工作?！　?、數(shù)字電路設(shè)計中，靜態(tài)時序模擬和動態(tài)時序模擬各有什么優(yōu)缺點? 靜態(tài)時序分析是采用窮盡分析方法來提取出整個電路存在的所有時序路徑， 計算信號在這些 路徑上的傳播延時， 檢查信號的建立和保持時間是否滿足時序要求， 通過對最大路徑延時和 最小路徑延時的分析，找出違背時序約束的錯誤。它不需要輸入向量就能窮盡所有的路徑， 且運行速度很快、占用內(nèi)存較少，不僅可以對芯片設(shè)計進行全面的時序功能檢查，而且還可 利用時序分析的結(jié)果來優(yōu)化設(shè)計， 因此靜態(tài)時序分析已經(jīng)越來越多地被用到數(shù)字集成電路設(shè) 計的驗證中。 動態(tài)時序模擬就是通常的仿真， 因為不可能產(chǎn)生完備的測試向量， 覆蓋門級網(wǎng)表中的每一條 路徑。因此在動態(tài)時序分析中，無法暴露一些路徑上可能存在的時序問題;　　6、多時域設(shè)計中，如何處理信號跨時域? 不同的時鐘域之間信號通信時需要進行同步處理， 這樣可以防止新時鐘域中第一級觸發(fā)器的 亞穩(wěn)態(tài)信號對下級邏輯造成影響，其中對于單個控制信號可以用兩級同步器，如電平、邊沿 檢測和脈沖，對多位信號可以用 FIFO，雙口 RAM，握手信號等。 跨時域的信號要經(jīng)過同步器同步，防止亞穩(wěn)態(tài)傳播。例如：時鐘域 1 中的一個信號，要送到 時鐘域 2，那么在這個信號送到時鐘域 2 之前，要先經(jīng)過時鐘域 2 的同步器同步后，才能進 入時鐘域 2。這個同步器就是兩級 D 觸發(fā)器，其時鐘為時鐘域 2 的時鐘。這樣做是怕時鐘域 1 中的這個信號，可能不滿足時鐘域 2 中觸發(fā)器的建立保持時間，而產(chǎn)生亞穩(wěn)態(tài)，因為它們 之間沒有必然關(guān)系，是異步的。這樣做只能防止亞穩(wěn)態(tài)傳播，但不能保證采進來的數(shù)據(jù)的正 確性。所以通常只同步很少位數(shù)的信號。比如控制信號，或地址。當同步的是地址時，一般 該地址應(yīng)采用格雷碼，因為格雷碼每次只變一位，相當于每次只有一個同步器在起作用，這 樣可以降低出錯概率， 象異步 FIFO 的設(shè)計中， 比較讀寫地址的大小時， 就是用這種方法。 如 果兩個時鐘域之間傳送大量的數(shù)據(jù)，可以用異步 FIFO 來解決問題。　　7、IC 設(shè)計中同步復(fù)位與異步復(fù)位有什么區(qū)別? 同步復(fù)位在時鐘沿采復(fù)位信號， 完成復(fù)位動作。 異步復(fù)位不管時鐘， 只要復(fù)位信號滿足條件， 就完成復(fù)位動作。 異步復(fù)位對復(fù)位信號要求比較高， 不能有毛刺， 如果其與時鐘關(guān)系不確定， 也可能出現(xiàn)亞穩(wěn)態(tài)?！　?、latch 與 register 有什么區(qū)別? latch 是電平觸發(fā)，register 是邊沿觸發(fā)，register 在同一時鐘邊沿觸發(fā)下動作，符合同 步電路的設(shè)計思想，而 latch 則屬于異步電路設(shè)計，往往會導(dǎo)致時序分析困難，不適當?shù)膽?yīng) 用 latch 則會大量浪費芯片資源?！　?、BLOCKING 和 NONBLOCKING 賦值有什么區(qū)別? 非阻塞賦值：塊內(nèi)的賦值語句同時賦值，一般用在時序電路描述中 阻塞賦值：完成該賦值語句后才能做下一句的操作，一般用在組合邏輯描述中　　10、Moore 與 Mealy 狀態(tài)機各有什么特征? Moore 狀態(tài)機的輸出僅與當前狀態(tài)值有關(guān),且只在時鐘邊沿到來時才會有狀態(tài)變化;Mealy 狀態(tài)機的輸出不僅與當前狀態(tài)值有關(guān),而且與當前輸入值有關(guān),這一特點使其控制和輸出更 加靈活,但同時也增加了設(shè)計復(fù)雜程度?！　?1、 什么是“線與”邏輯，要實現(xiàn)它，在硬件特性上有什么具體要求? 將幾個 OC 門結(jié)構(gòu)與非門輸出并聯(lián)，當每個 OC 門輸出為高電平時，總輸出才為高，這種連接 方式稱為線與?！　?2、 如何用 D 觸發(fā)器實現(xiàn) 2 倍分頻的邏輯電路? 把 D 觸發(fā)器的輸出端加非門接到 D 端即可實現(xiàn) 2 倍分頻的邏輯電路?！　?3、一個四級的 Mux，其中第二級信號為關(guān)鍵信號如何改善 timing? 關(guān)鍵：將第二級信號放到最后輸出一級輸出，同時注意修改片選信號，保證其優(yōu)先級未被修 改?！　?4、為什么一個標準的倒相器中 P 管的寬長比要比 N 管的寬長比大? 和載流子有關(guān)，P 管是空穴導(dǎo)電，N 管電子導(dǎo)電，電子的遷移率大于空穴，同樣的電場下，N 管的電流大于 P 管，因此要增大 P 管的寬長比，使之對稱，這樣才能使得兩者上升時間下降 時間相等、高低電平的噪聲容限一樣、充電放電的時間相等?！　?5、 什么是 Setup 和 Holdup 時間? 建立時間(setup time)是指在觸發(fā)器的時鐘信號上升沿到來以前，數(shù)據(jù)穩(wěn)定不變的時間， 如果建立時間不夠，數(shù)據(jù)將不能在這個時鐘上升沿被打入觸發(fā)器;保持時間(hold time) 是指在觸發(fā)器的時鐘信號上升沿到來以后，數(shù)據(jù)穩(wěn)定不變的時間，如果保持時間不夠，數(shù)據(jù) 同樣不能被打入觸發(fā)器?！　?6、如果已知 reg 的 setup,hold 時間，組合邏輯的 delay 需要在什么范圍內(nèi)? Delay T+T2max，T3hold>T1min+T2min

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本帖最后由 gk320830 于 2015-3-7 08:21 編輯 復(fù)位電路集錦

1. Q：我的ALLEGRO 是14.0版本的，F(xiàn)ILE——EXPORT——后面就沒有看到SUB DRAWING的命令了。如果用EDIT——COPY的話又不能把A板的線貼到B板上，我該怎么辦？A: 是不是你啟動Allegro 時Cadence Product Choices 沒選好,要選PCB Dedign Expert 或Allegro Expert~~~2. Q: 在ALLEGRO中，找個器件好難啊，他只是點亮器件而光標不移動到器件那里。請問各為大俠，有沒辦法可以象POWERPCB 那樣，查找零件時光標跟著移動？A:確認將元件點亮后，將鼠標移動至右下角的小顯示框中，單擊左鍵，光標即可自動轉(zhuǎn)到所點亮的元件處.3. Q: 將logic_edit_enabled打開后，只能刪除單個的net, logic_edit_enabled打開".是從何處打開???A: 在14.2中的操作：Setup -> User Preferences Editor -> Misc -> logic_edit_enabled然后可以在LOGIC/NET LOGIC 下刪除NET。4. Q: 想移動元件的某一個PIN ， 請問該如何做。用move 命令， 總提示Symbol or drawing must have UNFIXED_PINS property。A: edit -> properties 選中要move Pin的元件的symbols，增加UNFIXED_PINS 屬性即可。5.Q: how can i get rid of the "dynamic length" dialogue box?A: Setup -> User Preferences Editor ->Etch>allegro_etch_length_on6 .Q： 請問如何將以刪除的PIN NUMBER及SILKSCREEN還原??A：刪除此零件,再重新導(dǎo)入~~~或可以直接UPDATE 零件也可以7. Q：從orcad導(dǎo)入后，place->quickplace，但是出來的元件上面很多絲橫，就和鋪銅一樣，怎么回事？A：把PACKAGE GEOMETRY 的PLACE_BOUND_TOP 勾掉即可.8. Q：請問在allegro中,怎様畫一條沒有綠漆的綫??A：同樣位置再畫一根sold mask的線9. Q： 如何將走線的尖角過渡改成圓弧？A：可以直接畫圓弧上去，記得勾上replace etch，原來的線就沒了或使用slide 命令﹐然后在右邊的tab option選項中的comers改成arc,再去移動線﹐就可以改成圓弧﹗10.Q： allegro中覆銅的基本步驟是怎樣的？A：edit/shape進入shape編輯模式——edit/change net(pick)點上GND net——shape/parameters設(shè)置相關(guān)參數(shù)（看help）——void/auto進行shape處理——shape/fill退出shape編輯模式。11. Q：怎么設(shè)置參數(shù)才能得到THERMAL REILIF 的連接呢？A：在畫完鋪銅范圍以后，菜單會進入鋪銅狀態(tài)這時shape－－>parameters...對于負片，在做熱漂移焊盤前，必須先定義各類焊盤的FLASH SYMBOL，*.FSM文件，然后加到各類焊盤的鋪銅層，再鋪銅。做出光繪文件就能看見連接了。12.Q：請教如何修改手工銅的角度，還有就是我要在銅箔里挖一個VIA 或一個PIN 的空間，該如何做？？？？？？？？？A：edit-->shape,選取銅箔,點右鍵done,這時菜單改變了,可以用edit-->vertex 修改頂點的方式修改銅箔邊框角度.而挖空間要用到void中的shpe(多邊形)或circle(圓形)或Element(零件外形)要不干脆auto一下,自動會幫你挖好13 Q：Regular pad 、Anti-pad 和Thermal pad的區(qū)別A：真實焊盤大小、帶隔離大小焊盤、花焊盤14.Q： 怎么做方形（或其他非圓形）負片熱汗盤？A：做一個方形（或其他非圓形）的shape symbol，然后再在做pad時將shape symbol賦給flash～～15.Q： ALLEGRO中DRC標記的顯示，是否可以顯示為填充的，也就是像VIA那樣實心的。 A：當然可以了setup-->user preferences...勾選Display中的display_drcfill. 16. Q：allegro中怎么加淚滴(teardrop）？ A： 要先打開所有的走線層，執(zhí)行命令route->gloss->parameters.., 出現(xiàn)對話框，點選 pad and T connection fillet，再點其左邊的方格，點選circular pads,pins,vias,T connections./OK/GLOSS即可。加淚滴最好在出GERBER之前加。若要MODIFY板子，則要先刪掉淚滴，執(zhí)行命令EDIT/DELETE，右邊的FIND欄中選CLINE，下面的FIND BY NAME 中選property,點more，選FILLET=，/點APPLY/OK即可。無論加淚滴還是刪掉淚滴，一定要先打開所有的走線層，否則，沒打開的走線層就不會有執(zhí)行 17. Q：在ALLEGRO里打開的BRD里可導(dǎo)出元件，但是導(dǎo)出的元件如何加到庫里？ A：File-->Export-->Libraries...再將*.txt拷到你的device庫中，*.pad拷到pad庫中，其他的拷到你的psm庫中。 18.Q： ALLEGRO中有自動存盤系統(tǒng)嗎？？ A：自動存盤需要用戶自己設(shè)置，具體方法如下：（你沒設(shè)置前是否有默認目錄，找找看） setup>user preferences editer autosave 設(shè)定自動存盤 autosave_dbcheck: 設(shè)置存盤時是否需要數(shù)據(jù)檢查，如果此項設(shè)為存盤時需要數(shù)據(jù)檢查則會使存盤時間加長。 autosave_time: 自動存盤時間設(shè)置。默認值為30分鐘，自動存盤時間設(shè)定范圍10~100分鐘。 19.Q: 請問在制作元件的時候怎么定義元件的高度？ A:當你鋪好place_bound_top層shape以后，再執(zhí)行Setup-->Areas-->Package Height,點擊shape，此時Option 面板上就可以輸入高度了～～～ 20 Q:為什么在ALLEGRO的零件PADS顯示都是PADS外框線，怎樣才能顯示整個PADS，請指教！ A:Setup-->Drawing Options...Display: Filled pads and cline endcaps 勾選 21.Q:請問各位在Padstack Designer中的Padstack Layers的FILMMASK的作用及用**?? A:好像是用于助焊的，大小跟焊盤一樣大的 22. Q:請問如何設(shè)置在走線時,不自動避開 A:右邊的OPTIONS里面的BUBBLE邊上那個框里面先OFF 23.Q:在兩組插槽中間走了一組排線，由于在ＣＣＴ中使用無網(wǎng)格步線，所以線與線的間距有大有小，有沒有辦法將一組線間距調(diào)整到等距寬度，這樣比較美觀。在Ａｌｌｇｅｏ或ＣＣＴ中有無此調(diào)線的命令？ A:In cct, you can use post-route, spread wire and center wire. In allegro, you can use roue-glosss-parameter-ceneter lines between pads. 24.Q:請問如何有選擇性的更改，如，我只要改一個焊盤，或者我只要改一個器件 A:padstack--replace里可以改一個盤，或一個元件，或一類器件， 25. Q:如何在內(nèi)層看到therml孔 A:正片可以直接看到呀，負片在光繪文件上就可以看到的。在setUP\drawing options 中的display 中的thermal pads 打勾就是了 26.Q： 如何在rename的時候把部分器件保護起來？！[ A：給你所有要重新rename位號的器件添加一個auto_rename屬性！ 27.Q：怎么在ALLEGRO下使鋪的銅不被涂上阻旱劑？ A： 開阻焊窗。在阻焊層鋪一塊同樣大小銅。 28. Q：這是我設(shè)計的一塊雙面板,上下兩部分是對稱的,現(xiàn)已經(jīng)將上半部分的線布完,我想將這部分的線復(fù)制到下半部分,要求沿水平方向翻轉(zhuǎn)下來,請教如何在Allegro中實現(xiàn),請指教~~~~ A：在COPY 命令下，如果要mirror 多條線時，先拉個框選種，然后要鼠標左鍵點一下（這時被選種的內(nèi)容可以移動），然后再右擊，出現(xiàn)的"Mirror Geometry"選項就不顯灰了呀發(fā)貼時間： Dec 12 2005 4:53PM ||Chris Li Offline發(fā)表：929. Q：有一個LOGO，是.bmp 圖象文件，請問怎樣將它導(dǎo)入ALLEGRO設(shè)計中，并且以SILKSCREEN的形式顯示 A：借助第三方軟件﹐把*.bmp 轉(zhuǎn)成*.dxf,然后在allegro 中導(dǎo)入dxf 文件﹗﹗﹗先將bmp 轉(zhuǎn)成dxf，再生成format symbo！ 30. Q：如何讓VIA在BGA的PIN間居中: A：你只能直接輸入坐標定位，算好間距后，然后用矩陣復(fù)制就可以了。矩陣復(fù)制就是，選中copy按鈕，在option下面的Qty下分別填入數(shù)值，即可復(fù)制 X表示橫向復(fù)制 Y表示縱向復(fù)制 Qty表示你要復(fù)制幾次（就是說復(fù)制幾個via） Spacing表示復(fù)制的這幾個via間距都是多少 Order表示復(fù)制的方向。比如X方向復(fù)制，你在Order選擇Right，就是從你復(fù)制的這個原始via開始向右復(fù)制依次的Left 表示向左復(fù)制。Down和Up分別表示向下和向上復(fù)制。 31. Q ：請教ALLEGRO中的Manufacture->dfa check的功能為何?? A：深層次的應(yīng)用，需要Skill語言的支持 32. Q：如何在Allegro中只顯示連線，不顯示同一層的鋪銅有的時候檢查某一層的時候，既有連線又有鋪銅很難檢查 A：可以將除了鋪銅之外的所有線都hilight那么就只有鋪銅是Dehilight 然后使用Display--Color Priority，關(guān)閉鋪銅的那個顏色這時候，這一層就只顯示連線了不過需要注意的是，這一層的via、pad、等等的顏色不能和鋪銅的顏色一樣，否則將會一起不顯示了, 也可以改變shape顯示的格點,在user preference editor中display選項卡,將display_shapefill一欄中的值填5～10之間的某個數(shù)(象素),這樣shape在顯示時就不是那么顯眼了. 33. Q：請教Allegro的兩個功能 Setup------Property Definitions 有什么功能和如何使用 Setup------Define Lists……怎么用 A：請參考下面： Setup------Property Definitions 是添加一些用戶的設(shè)定，雖然Allegro 里的Edit Property里的設(shè)定已經(jīng)很多了，可能還有很多用戶希望的沒有，所以用戶可以自己發(fā)揮； Setup------Define Lists 可以輸出相關(guān)的信息，按照上面的選項，點擊->按鈕選add，然后選show就可以了， 34. Q： 請教如何替換封裝? A：請參考下面：在Device中定義的語法是： PACKAGEPROP ALT_SYMBOLS '(Subclass:Symbol,...;Subclass:Symbol,...)' 其中Subclass可設(shè)定為Top層和Bottom層，Top層的表示可以用“T”來表示，Bottom層的表示可以用“B”來表示。若Subclass沒有進行設(shè)定表示，系統(tǒng)會認為是Top層。例：原先的零件包裝為R0805，我們要設(shè)定它可以和Top曾的R0603和Bottom層的R1206進行包裝的轉(zhuǎn)換。 Device File中的定義： PACKAGE R0805 CLASS IC PINCOUNT 2 PACKAGEPROP ALT_SYMBOLS '(T：R0603；B：R1206)' END 這個Device文檔就表示R0805這顆零件可以和top層上包裝為R0603和Bottom層的零件包裝為R1206的零件進行更換。注：一定要用一組單引號把所要轉(zhuǎn)換的零件框在里面。35. Q：執(zhí)行什么動作才能讓已有的via轉(zhuǎn)換為測試點，或者你們是怎么生成測試點的。 A：rout-->testprep-->auto...中選中replace via 36. Q：請教一個奇怪的鋪銅現(xiàn)象我用ADD_SHAP_SOLID FILL,設(shè)LIN WIDTH 為4,加上后用了EDIT SHAP,設(shè)網(wǎng)絡(luò)名為GND,并使 VOID AUTO.但是不能自動避開其它網(wǎng)絡(luò). A：請參考下面：不能小與0.003 0.003是指當執(zhí)行Auto void時小于這個值的shape就自動刪除，單位為：平方英寸。 37.Q：請問View--Color view save是什么作用A：第一個Complete，保存后的文件用寫字板打開可以看到當前打開的所有顏色的記錄第二個選項是記錄了之前對顯示哪些、不顯示那些的操作 38.Q：我在SETUP USER PREFERENCES里面進行了設(shè)置,但退出后就沒有了,不能保存?下次進入還是缺省值? A：參考下面：問題主要可能是：因為Allegro不支持空格符號，而Windows XP系統(tǒng)裝好Allegro后默認的Pcbenv會放在用戶目錄下，即： d:\Documents and Settings\×××\pcbenv 而其中正好有空格。解決方案為：更改Pcbenv的位置。步驟： 1． 右擊我的電腦，進入屬性設(shè)置?高級?環(huán)境變量 2． 點擊系統(tǒng)變量的新建，變量名：home 變量值：任何一個絕對路徑，注意不要有空格的路徑，例：D:確定就可以了 39. Q：請教怎么樣做一個弧形陣列的元件! A：你在加Pin的時候，option里的copy mode選polar就可以了，其它和普通加矩陣pin設(shè)置差不多！ 40. Q：ALLEGRO特殊規(guī)則區(qū)是怎樣做出來的（例如線進入這個區(qū)域線寬會有變化） A：setup->constraints-> add area 在spacing / physical rules set 的set value 中設(shè)定一種所需的spacing/physical edit ->properties 選剛才畫的area(that is a shape) 選net_spacing_type net_physical_type 填入一個名字,最好能表現(xiàn)他的屬性, setup->constraints-> 在spacing / physical rules set 中分別點assignment table 套用上去就可以了. 另外,還有一種添加area 的方法. add -> shape ->unfilled class board geometry sub_class constraint_area

1. Q：我的ALLEGRO 是14.0版本的，F(xiàn)ILE——EXPORT——后面就沒有看到SUB DRAWING的命令了。如果用EDIT——COPY的話又不能把A板的線貼到B板上，我該怎么辦？A: 是不是你啟動Allegro 時Cadence Product Choices 沒選好,要選PCB Dedign Expert 或Allegro Expert~~~2. Q: 在ALLEGRO中，找個器件好難啊，他只是點亮器件而光標不移動到器件那里。請問各為大俠，有沒辦法可以象POWERPCB 那樣，查找零件時光標跟著移動？A:確認將元件點亮后，將鼠標移動至右下角的小顯示框中，單擊左鍵，光標即可自動轉(zhuǎn)到所點亮的元件處.3. Q: 將logic_edit_enabled打開后，只能刪除單個的net, logic_edit_enabled打開".是從何處打開???A: 在14.2中的操作：Setup -> User Preferences Editor -> Misc -> logic_edit_enabled然后可以在LOGIC/NET LOGIC 下刪除NET。4. Q: 想移動元件的某一個PIN ， 請問該如何做。用move 命令， 總提示Symbol or drawing must have UNFIXED_PINS property。A: edit -> properties 選中要move Pin的元件的symbols，增加UNFIXED_PINS 屬性即可。5.Q: how can i get rid of the "dynamic length" dialogue box?A: Setup -> User Preferences Editor ->Etch>allegro_etch_length_on6 .Q： 請問如何將以刪除的PIN NUMBER及SILKSCREEN還原??A：刪除此零件,再重新導(dǎo)入~~~或可以直接UPDATE 零件也可以7. Q：從orcad導(dǎo)入后，place->quickplace，但是出來的元件上面很多絲橫，就和鋪銅一樣，怎么回事？A：把PACKAGE GEOMETRY 的PLACE_BOUND_TOP 勾掉即可.8. Q：請問在allegro中,怎様畫一條沒有綠漆的綫??A：同樣位置再畫一根sold mask的線9. Q： 如何將走線的尖角過渡改成圓??？A：可以直接畫圓弧上去，記得勾上replace etch，原來的線就沒了或使用slide 命令﹐然后在右邊的tab option選項中的comers改成arc,再去移動線﹐就可以改成圓弧﹗10.Q： allegro中覆銅的基本步驟是怎樣的？A：edit/shape進入shape編輯模式——edit/change net(pick)點上GND net——shape/parameters設(shè)置相關(guān)參數(shù)（看help）——void/auto進行shape處理——shape/fill退出shape編輯模式。11. Q：怎么設(shè)置參數(shù)才能得到THERMAL REILIF 的連接呢？A：在畫完鋪銅范圍以后，菜單會進入鋪銅狀態(tài)這時shape－－>parameters...對于負片，在做熱漂移焊盤前，必須先定義各類焊盤的FLASH SYMBOL，*.FSM文件，然后加到各類焊盤的鋪銅層，再鋪銅。做出光繪文件就能看見連接了。12.Q：請教如何修改手工銅的角度，還有就是我要在銅箔里挖一個VIA 或一個PIN 的空間，該如何做？？？？？？？？？A：edit-->shape,選取銅箔,點右鍵done,這時菜單改變了,可以用edit-->vertex 修改頂點的方式修改銅箔邊框角度.而挖空間要用到void中的shpe(多邊形)或circle(圓形)或Element(零件外形)要不干脆auto一下,自動會幫你挖好13 Q：Regular pad 、Anti-pad 和Thermal pad的區(qū)別A：真實焊盤大小、帶隔離大小焊盤、花焊盤14.Q： 怎么做方形（或其他非圓形）負片熱汗盤？A：做一個方形（或其他非圓形）的shape symbol，然后再在做pad時將shape symbol賦給flash～～15.Q： ALLEGRO中DRC標記的顯示，是否可以顯示為填充的，也就是像VIA那樣實心的。 A：當然可以了setup-->user preferences...勾選Display中的display_drcfill. 16. Q：allegro中怎么加淚滴(teardrop）？ A： 要先打開所有的走線層，執(zhí)行命令route->gloss->parameters.., 出現(xiàn)對話框，點選 pad and T connection fillet，再點其左邊的方格，點選circular pads,pins,vias,T connections./OK/GLOSS即可。加淚滴最好在出GERBER之前加。若要MODIFY板子，則要先刪掉淚滴，執(zhí)行命令EDIT/DELETE，右邊的FIND欄中選CLINE，下面的FIND BY NAME 中選property,點more，選FILLET=，/點APPLY/OK即可。無論加淚滴還是刪掉淚滴，一定要先打開所有的走線層，否則，沒打開的走線層就不會有執(zhí)行 17. Q：在ALLEGRO里打開的BRD里可導(dǎo)出元件，但是導(dǎo)出的元件如何加到庫里？ A：File-->Export-->Libraries...再將*.txt拷到你的device庫中，*.pad拷到pad庫中，其他的拷到你的psm庫中。 18.Q： ALLEGRO中有自動存盤系統(tǒng)嗎？？ A：自動存盤需要用戶自己設(shè)置，具體方法如下：（你沒設(shè)置前是否有默認目錄，找找看） setup>user preferences editer autosave 設(shè)定自動存盤 autosave_dbcheck: 設(shè)置存盤時是否需要數(shù)據(jù)檢查，如果此項設(shè)為存盤時需要數(shù)據(jù)檢查則會使存盤時間加長。 autosave_time: 自動存盤時間設(shè)置。默認值為30分鐘，自動存盤時間設(shè)定范圍10~100分鐘。 19.Q: 請問在制作元件的時候怎么定義元件的高度？ A:當你鋪好place_bound_top層shape以后，再執(zhí)行Setup-->Areas-->Package Height,點擊shape，此時Option 面板上就可以輸入高度了～～～ 20 Q:為什么在ALLEGRO的零件PADS顯示都是PADS外框線，怎樣才能顯示整個PADS，請指教！ A:Setup-->Drawing Options...Display: Filled pads and cline endcaps 勾選 21.Q:請問各位在Padstack Designer中的Padstack Layers的FILMMASK的作用及用**?? A:好像是用于助焊的，大小跟焊盤一樣大的 22. Q:請問如何設(shè)置在走線時,不自動避開 A:右邊的OPTIONS里面的BUBBLE邊上那個框里面先OFF 23.Q:在兩組插槽中間走了一組排線，由于在ＣＣＴ中使用無網(wǎng)格步線，所以線與線的間距有大有小，有沒有辦法將一組線間距調(diào)整到等距寬度，這樣比較美觀。在Ａｌｌｇｅｏ或ＣＣＴ中有無此調(diào)線的命令？ A:In cct, you can use post-route, spread wire and center wire. In allegro, you can use roue-glosss-parameter-ceneter lines between pads. 24.Q:請問如何有選擇性的更改，如，我只要改一個焊盤，或者我只要改一個器件 A:padstack--replace里可以改一個盤，或一個元件，或一類器件， 25. Q:如何在內(nèi)層看到therml孔 A:正片可以直接看到呀，負片在光繪文件上就可以看到的。在setUP\drawing options 中的display 中的thermal pads 打勾就是了 26.Q： 如何在rename的時候把部分器件保護起來？！[ A：給你所有要重新rename位號的器件添加一個auto_rename屬性！ 27.Q：怎么在ALLEGRO下使鋪的銅不被涂上阻旱劑？ A： 開阻焊窗。在阻焊層鋪一塊同樣大小銅。 28. Q：這是我設(shè)計的一塊雙面板,上下兩部分是對稱的,現(xiàn)已經(jīng)將上半部分的線布完,我想將這部分的線復(fù)制到下半部分,要求沿水平方向翻轉(zhuǎn)下來,請教如何在Allegro中實現(xiàn),請指教~~~~ A：在COPY 命令下，如果要mirror 多條線時，先拉個框選種，然后要鼠標左鍵點一下（這時被選種的內(nèi)容可以移動），然后再右擊，出現(xiàn)的"Mirror Geometry"選項就不顯灰了呀發(fā)貼時間： Dec 12 2005 4:53PM ||Chris Li Offline發(fā)表：929. Q：有一個LOGO，是.bmp 圖象文件，請問怎樣將它導(dǎo)入ALLEGRO設(shè)計中，并且以SILKSCREEN的形式顯示 A：借助第三方軟件﹐把*.bmp 轉(zhuǎn)成*.dxf,然后在allegro 中導(dǎo)入dxf 文件﹗﹗﹗先將bmp 轉(zhuǎn)成dxf，再生成format symbo！ 30. Q：如何讓VIA在BGA的PIN間居中: A：你只能直接輸入坐標定位，算好間距后，然后用矩陣復(fù)制就可以了。矩陣復(fù)制就是，選中copy按鈕，在option下面的Qty下分別填入數(shù)值，即可復(fù)制 X表示橫向復(fù)制 Y表示縱向復(fù)制 Qty表示你要復(fù)制幾次（就是說復(fù)制幾個via） Spacing表示復(fù)制的這幾個via間距都是多少 Order表示復(fù)制的方向。比如X方向復(fù)制，你在Order選擇Right，就是從你復(fù)制的這個原始via開始向右復(fù)制依次的Left 表示向左復(fù)制。Down和Up分別表示向下和向上復(fù)制。 31. Q ：請教ALLEGRO中的Manufacture->dfa check的功能為何?? A：深層次的應(yīng)用，需要Skill語言的支持 32. Q：如何在Allegro中只顯示連線，不顯示同一層的鋪銅有的時候檢查某一層的時候，既有連線又有鋪銅很難檢查 A：可以將除了鋪銅之外的所有線都hilight那么就只有鋪銅是Dehilight 然后使用Display--Color Priority，關(guān)閉鋪銅的那個顏色這時候，這一層就只顯示連線了不過需要注意的是，這一層的via、pad、等等的顏色不能和鋪銅的顏色一樣，否則將會一起不顯示了, 也可以改變shape顯示的格點,在user preference editor中display選項卡,將display_shapefill一欄中的值填5～10之間的某個數(shù)(象素),這樣shape在顯示時就不是那么顯眼了. 33. Q：請教Allegro的兩個功能 Setup------Property Definitions 有什么功能和如何使用 Setup------Define Lists……怎么用 A：請參考下面： Setup------Property Definitions 是添加一些用戶的設(shè)定，雖然Allegro 里的Edit Property里的設(shè)定已經(jīng)很多了，可能還有很多用戶希望的沒有，所以用戶可以自己發(fā)揮； Setup------Define Lists 可以輸出相關(guān)的信息，按照上面的選項，點擊->按鈕選add，然后選show就可以了， 34. Q： 請教如何替換封裝? A：請參考下面：在Device中定義的語法是： PACKAGEPROP ALT_SYMBOLS '(Subclass:Symbol,...;Subclass:Symbol,...)' 其中Subclass可設(shè)定為Top層和Bottom層，Top層的表示可以用“T”來表示，Bottom層的表示可以用“B”來表示。若Subclass沒有進行設(shè)定表示，系統(tǒng)會認為是Top層。例：原先的零件包裝為R0805，我們要設(shè)定它可以和Top曾的R0603和Bottom層的R1206進行包裝的轉(zhuǎn)換。 Device File中的定義： PACKAGE R0805 CLASS IC PINCOUNT 2 PACKAGEPROP ALT_SYMBOLS '(T：R0603；B：R1206)' END 這個Device文檔就表示R0805這顆零件可以和top層上包裝為R0603和Bottom層的零件包裝為R1206的零件進行更換。注：一定要用一組單引號把所要轉(zhuǎn)換的零件框在里面。35. Q：執(zhí)行什么動作才能讓已有的via轉(zhuǎn)換為測試點，或者你們是怎么生成測試點的。 A：rout-->testprep-->auto...中選中replace via 36. Q：請教一個奇怪的鋪銅現(xiàn)象我用ADD_SHAP_SOLID FILL,設(shè)LIN WIDTH 為4,加上后用了EDIT SHAP,設(shè)網(wǎng)絡(luò)名為GND,并使 VOID AUTO.但是不能自動避開其它網(wǎng)絡(luò). A：請參考下面：不能小與0.003 0.003是指當執(zhí)行Auto void時小于這個值的shape就自動刪除，單位為：平方英寸。 37.Q：請問View--Color view save是什么作用A：第一個Complete，保存后的文件用寫字板打開可以看到當前打開的所有顏色的記錄第二個選項是記錄了之前對顯示哪些、不顯示那些的操作 38.Q：我在SETUP USER PREFERENCES里面進行了設(shè)置,但退出后就沒有了,不能保存?下次進入還是缺省值? A：參考下面：問題主要可能是：因為Allegro不支持空格符號，而Windows XP系統(tǒng)裝好Allegro后默認的Pcbenv會放在用戶目錄下，即： d:\Documents and Settings\×××\pcbenv 而其中正好有空格。解決方案為：更改Pcbenv的位置。步驟： 1． 右擊我的電腦，進入屬性設(shè)置?高級?環(huán)境變量 2． 點擊系統(tǒng)變量的新建，變量名：home 變量值：任何一個絕對路徑，注意不要有空格的路徑，例：D:確定就可以了 39. Q：請教怎么樣做一個弧形陣列的元件! A：你在加Pin的時候，option里的copy mode選polar就可以了，其它和普通加矩陣pin設(shè)置差不多！ 40. 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