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AD800和AD802采用二階鎖相環(huán)結(jié)構(gòu),對不歸零(NRZ)數(shù)據(jù)執(zhí)行時鐘恢復(fù)和數(shù)據(jù)重定時。這種結(jié)構(gòu)可支持20 Mbps至160 Mbps范圍內(nèi)的數(shù)據(jù)速率。此處所述的產(chǎn)品規(guī)定以標準電信比特率工作。AD800-45和AD800-52分別支持45 Mbps DS-3和52 Mbps STS-1。AD802-155支持155 Mbps STS-3或STM-1。????????????????????????????????????
與其它基于PLL的時鐘恢復(fù)電路不同,這些器件不需要前同步碼或外部VCXO來鎖定輸入數(shù)據(jù)。電路利用兩個控制環(huán)路采集頻率和相位鎖定。首先由頻率采集控制環(huán)路采集輸入數(shù)據(jù)的時鐘頻率,然后由鎖相環(huán)采集輸入數(shù)據(jù)的相位,并確保輸出信號相位跟蹤輸出數(shù)據(jù)相位的變化。電路的環(huán)路阻尼取決于用戶所選電容的值;它決定抖動峰值和性能,并影響采集時間。這些器件的抖動峰值為0.08 dB;當阻尼系數(shù)為5時,可以在4 X 105 位周期內(nèi)鎖定隨機或加擾數(shù)據(jù)。
在采集過程中,鑒頻器提供一個頻率采集(FRAC)信號,指示器件尚未鎖定輸入數(shù)據(jù)。此信號是一系列脈沖,出現(xiàn)在輸入數(shù)據(jù)與同步時鐘信號之間的周跳點。一旦電路采集到頻率鎖定,F(xiàn)RAC輸出就不會出現(xiàn)脈沖。
器件中內(nèi)置經(jīng)過精密調(diào)整的VCO,不需要用于設(shè)置中心頻率的外部器件,從而也不需要對這些器件進行調(diào)整。無輸入數(shù)據(jù)時,VCO提供器件中心頻率±20%范圍內(nèi)的時鐘輸出。
取得專利的鑒相器具有出色的性能,因而AD800和AD802幾乎沒有碼抖動。總環(huán)路抖動為20°峰峰值。抖動帶寬由掩模可編程小數(shù)環(huán)路帶寬決定。AD800用于90 Mbps以下的數(shù)據(jù)速率,標稱環(huán)路帶寬為中心頻率的0.1%。AD802用于90 Mbps以上的數(shù)據(jù)速率,環(huán)路帶寬為中心頻率的0.08%。
所有器件均采用+5 V或-5.2 V單電源供電。