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在目前電子系統(tǒng)的設(shè)計(jì)中， DSP+ FPGA 架構(gòu)越來(lái)越多， 其原因在于該架構(gòu)兼顧了速度和靈活性。通用 DSP的優(yōu)點(diǎn)是通過(guò)編程可以廣泛應(yīng)用到產(chǎn)品中，并且主流制造商生產(chǎn)的 DSP 已能滿足算法控制結(jié)構(gòu)復(fù)雜、運(yùn)算速度高、尋址方式靈活和通信性能強(qiáng)大等需求。但是傳統(tǒng)的 DSP 采用馮 - 諾依曼結(jié)構(gòu)或某種類(lèi)型擴(kuò)展。此種結(jié)構(gòu)本質(zhì)上是串行的， 因此遇到需處理的數(shù)據(jù)量大， 對(duì)處理速度要求高， 但是對(duì)運(yùn)算結(jié)構(gòu)相對(duì)比較簡(jiǎn)單的底層信號(hào)處理算法則顯不出優(yōu)點(diǎn)， 適合采用 FPGA 硬件實(shí)現(xiàn)。而采用 DSP+ FPGA 的數(shù)字硬件系統(tǒng)就可以把二者優(yōu)點(diǎn)結(jié)合起來(lái)， 兼顧速度和靈活性， 既滿足底層信號(hào)處理要求， 又滿足高層信號(hào)處理要求。采用此架構(gòu)， 就不可避免地遇到 FPGA 與DSP之間數(shù)據(jù)通信的問(wèn)題。本文討論了異步 FIFO 在FPGA 與 DSP 通信中的運(yùn)用， 該方法具有傳輸速度快 穩(wěn)定可靠并且實(shí)現(xiàn)方便等
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