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在芯片的研發(fā)環(huán)節(jié)，FPGA 驗(yàn)證是其中的重要的組成部分，如何有效的利用FPGA 的資源，
管腳分配也是必須考慮的一個(gè)重要問題。一般較好的方法是在綜合過程中通過時(shí)序的一些約
束讓對應(yīng)的工具自動(dòng)分配，但是從研發(fā)的時(shí)間段上來考慮這種方法往往是不可取的，RTL
驗(yàn)證與驗(yàn)證板設(shè)計(jì)必須是同步進(jìn)行的，在驗(yàn)證代碼出來時(shí)驗(yàn)證的單板也必須設(shè)計(jì)完畢，也就
是管腳的分配也必須在設(shè)計(jì)代碼出來之前完成。所以，管腳的分配更多的將是依賴人，而非
工具，這個(gè)時(shí)候就更需要考慮各方面的因素。
管腳分配也是必須考慮的一個(gè)重要問題。一般較好的方法是在綜合過程中通過時(shí)序的一些約
束讓對應(yīng)的工具自動(dòng)分配，但是從研發(fā)的時(shí)間段上來考慮這種方法往往是不可取的，RTL
驗(yàn)證與驗(yàn)證板設(shè)計(jì)必須是同步進(jìn)行的，在驗(yàn)證代碼出來時(shí)驗(yàn)證的單板也必須設(shè)計(jì)完畢，也就
是管腳的分配也必須在設(shè)計(jì)代碼出來之前完成。所以，管腳的分配更多的將是依賴人，而非
工具，這個(gè)時(shí)候就更需要考慮各方面的因素。
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