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采用FPGA實現(xiàn)對AD 輸出數(shù)據(jù)的高速采集
使用FPGA［1］產(chǎn)生CY7C68013的讀寫控制邏輯和AD芯片的AD采集時鐘，最大限度地利用數(shù)據(jù)傳輸帶寬，最高采樣率可達到80Mbyte／s。針對傳統(tǒng)的基于主控制器的AD采集系統(tǒng)存在著耗費 CPU資源、不利于高速采樣等缺點，設計了基于復雜可編程邏輯器件（FPGA）和高速AD轉換器、輔以必要外圍器件的新型AD采集系統(tǒng)。該系統(tǒng)具有不占用主控制器資源、采樣速度快且可調(diào)、可靠性高、配置靈活、成本低等一系列優(yōu)點。 2 AD采集卡總體設計方案在A／D采集卡…上為了驗證的需要，還加入了 D／A9760轉換芯片，用于實時還原采樣波形。 USB2．0接口用于和上位機進行數(shù)據(jù)通信。擴展接口用于和ARM系統(tǒng)進行采樣數(shù)據(jù)傳輸。A／D采集卡系統(tǒng)框圖如圖l所示。
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