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本文檔的主要內容詳細介紹的是virtex-6 FPGA HX250T和HX380T的CES勘誤表資料免費下載。
感謝您使用Xilinx Virtex6系列設備進行設計。盡管Xilinx已盡一切努力確保盡可能高的質量，但表1中列出的設備受到以下勘誤表中所述的限制。
當相位頻率檢測器（pfd）頻率（fin/d）低于135兆赫，并且mmcm的帶寬屬性設置為高或優(yōu)化時，mmcm輸出時鐘之間會發(fā)生相位誤差，使輸出時鐘信號無效。這種情況也會導致分數輸出計數器失效。
ISE?軟件V12.4及更高版本為可能違反此限制提供了適當的警告。
ISE軟件V12.4及更高版本正確處理所有有效PFD頻率的優(yōu)化帶寬設計。
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