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SN65LVDS302 接收器將與 FlatLink™3G 兼容的串行 輸入數(shù)據(jù)解串為 27 個并行數(shù)據(jù)輸出。SN65LVDS302 接收器包含一個移位寄存器，在檢查奇偶校驗位之后， 此寄存器從 1、2 或 3 個串行輸入載入 30 位，并且將 24 個像素位和 3 個控制位鎖存至并行 CMOS 輸出。 如果奇偶校驗確認奇偶校驗正確，通道奇偶校驗錯誤 (CPE) 輸出保持低電平。如果檢測到奇偶校驗錯誤， CPE 輸出生成一個高脈沖，而數(shù)據(jù)輸出總線忽略剛剛 接收到的像素。或者，最后一個數(shù)據(jù)字在下一個時鐘周 期內(nèi)被保持在輸出總線上。
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