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74ALVCH16843 有兩個 9 位 D 型鎖存器，每個鎖存器都有獨立的 D 型輸入 以及用于總線導(dǎo)向應(yīng)用的 3 態(tài)輸出。每個寄存器的兩個部分都受到控制 獨立地由鎖存使能 （nLE）、清零 （nCLR）、預(yù)設(shè) （nPRE） 和輸出使能 （nOE） 獨立 控制閘門。 當(dāng)nOE為低電平時，寄存器中的數(shù)據(jù)出現(xiàn)在輸出端。當(dāng) nOE 為高電平時，輸出 處于高阻抗 OFF 狀態(tài)。nOE 輸入的操作不會影響 人字拖。 74ALVCH16843 具有有源總線保持電路，用于保持未使用或浮動 有效邏輯級別的數(shù)據(jù)輸入。此功能消除了對外部上拉或下拉的需要 電阻。 2. 特點和優(yōu)勢 • 1.2 V 至 3.6 V 的寬電源電壓范圍 • CMOS低功耗 • 與TTL電平直接接口 • VCC = 3.0 V 時電流驅(qū)動 ±24 mA。 • MULTIBYTE™ 直通式標(biāo)準(zhǔn)引腳架構(gòu) • • 所有數(shù)據(jù)輸入都有總線保持 • 輸出驅(qū)動能力：85 °C 下 50 Ω傳輸線 • • 符合JEDEC標(biāo)準(zhǔn)： 3 態(tài)同相輸出，適用于總線導(dǎo)向應(yīng)用 低電感多個 VCC 和 GND 引腳，可較大限度地降低噪聲和接地反彈 • • JESD8-5（2.3 V至2.7 V） JESD8B/JESD36（2.7 V至3.6 V）
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