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設(shè)計(jì)了一種以線陣CCD作為光電傳感器的測(cè)隙裝置。首先設(shè)計(jì)了測(cè)隙裝置的總體方案，分析了方案的可行性；其次以CPLD為驅(qū)動(dòng)利用Verlog-HDL語言設(shè)計(jì)了線陣CCD的工作時(shí)序，在對(duì)輸出信號(hào)分析的基礎(chǔ)上，設(shè)計(jì)了適用于本裝置的二值化電路；最后以單片機(jī)采集數(shù)據(jù)并實(shí)現(xiàn)了和PC間的通訊。從實(shí)驗(yàn)結(jié)果來看，方案達(dá)到了設(shè)計(jì)中的要求，測(cè)量分辨率達(dá)到了±0.011 mm。
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