時(shí)序

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這里所說(shuō)的時(shí)序其實(shí)就是指時(shí)序圖，又名序列圖、循序圖、順序圖，是一種UML交互圖。它通過(guò)描述對(duì)象之間發(fā)送消息的時(shí)間順序顯示多個(gè)對(duì)象之間的動(dòng)態(tài)協(xié)作。

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時(shí)序技術(shù)

靜態(tài)時(shí)序分析基礎(chǔ)與應(yīng)用連載（1）

在制程進(jìn)入深次微米世代之后，晶片（IC）設(shè)計(jì)的高復(fù)雜度及系統(tǒng)單晶片（SOC）設(shè)計(jì)方式興起。

2017-02-11 標(biāo)簽：時(shí)序靜態(tài)時(shí)序 1671 0

FIFO為什么不能正常工作？

FIFO為什么不能正常工作？復(fù)位信號(hào)有效長(zhǎng)度不夠，接口時(shí)序不匹配，可看下面這篇文章。本文將介紹：非DFX工程如何確保異步FIFO自帶的set_max...

2023-11-02 標(biāo)簽：fpga FPGA設(shè)計(jì)fifo 1650 0

XDC約束技巧之I/O篇（下）

繼《XDC 約束技巧之 I/O 篇（上）》詳細(xì)描述了如何設(shè)置 Input 接口約束后，我們接著來(lái)聊聊怎樣設(shè)置 Output 接口約束，并分析 UCF ...

2023-04-10 標(biāo)簽：接口信號(hào)時(shí)序 1570 0

MAXQ30微控制器的模塊化冪運(yùn)算時(shí)序

32位DeepCover安全微控制器（MAXQ1050、MAXQ1850和MAXQ1103）為執(zhí)行模塊化運(yùn)算提供硬件支持。這是使用稱(chēng)為模塊化算術(shù)加速器 ...

2023-01-12 標(biāo)簽：微控制器總線(xiàn)時(shí)序 1565 0

時(shí)序約束--多時(shí)鐘

對(duì)于邏輯N而言，由clka產(chǎn)生數(shù)據(jù)，clkc采樣數(shù)據(jù)，在它們周期的最小公倍數(shù)內(nèi)，最嚴(yán)格的時(shí)序是3ns產(chǎn)生數(shù)據(jù)，在4ns采樣。只要保證最嚴(yán)格的情形下，電路...

2023-04-06 標(biāo)簽：分頻器時(shí)序 1513 0

如何在EDA工具中屏蔽冗余的違例信息

在進(jìn)行數(shù)字電路后仿真時(shí)，經(jīng)常會(huì)遇到很多時(shí)序?yàn)槔ǔ＿@些違例都是由網(wǎng)表中大量的時(shí)序檢查報(bào)出的。這些常見(jiàn)的時(shí)序檢查系統(tǒng)任務(wù)如下表所示：

2023-08-19 標(biāo)簽：仿真 eda 數(shù)字電路 1502 0

Vivado Schematic中的實(shí)線(xiàn)和虛線(xiàn)有什么區(qū)別？

2023-06-06 標(biāo)簽：fpga 時(shí)序 Schematic 1459 0

用TCL定制Vivado設(shè)計(jì)實(shí)現(xiàn)流程

今天推出Xilinx已發(fā)布的《Vivado使用誤區(qū)與進(jìn)階》系列：用TCL定制Vivado設(shè)計(jì)實(shí)現(xiàn)流程。

2023-05-05 標(biāo)簽：fpga Xilinx TCL 1442 0

FlexSPI外設(shè)如何支持行列混合尋址存儲(chǔ)器

關(guān)于FlexSPI外設(shè)的lookupTable，之前寫(xiě)過(guò)一篇非常詳細(xì)的文章《從頭開(kāi)始認(rèn)識(shí)i.MX RT啟動(dòng)頭FDCB里的lookupTable》，這篇...

2022-10-13 標(biāo)簽：寄存器存儲(chǔ)器時(shí)序 1407 0

FPGA設(shè)計(jì)中經(jīng)常犯的10個(gè)錯(cuò)誤

本文列出了FPGA設(shè)計(jì)中常見(jiàn)的十個(gè)錯(cuò)誤。我們收集了 FPGA 工程師在其設(shè)計(jì)中犯的 10 個(gè)最常見(jiàn)錯(cuò)誤，并提供了解決方案的建議和替代方案。本文假定讀者已...

2023-05-31 標(biāo)簽：fpga FPGA設(shè)計(jì)RTL 1392 1

FlexSPI外設(shè)關(guān)于行列地址Memory支持

但是市面上也有一些特殊的存儲(chǔ)器（比如八線(xiàn) HyperBus Flash/RAM， OctalRAM 等）采用了行列混合尋址方式，對(duì)于這類(lèi)存儲(chǔ)器，我們?cè)?...

2022-10-14 標(biāo)簽：存儲(chǔ)器 Memory 時(shí)序 1376 0

FPGA設(shè)計(jì)：時(shí)序是關(guān)鍵

當(dāng)你的FPGA設(shè)計(jì)不能滿(mǎn)足時(shí)序要求時(shí)，原因也許并不明顯。解決方案不僅僅依賴(lài)于使用FPGA的實(shí)現(xiàn)工具來(lái)優(yōu)化設(shè)計(jì)從而滿(mǎn)足時(shí)序要求，也需要設(shè)計(jì)者具有明確目標(biāo)和...

2014-08-15 標(biāo)簽：FPGA 時(shí)序 RTL代碼 1363 1

不同操作系統(tǒng)間QoR性能存在差異

本篇博文中的分析是根據(jù)真實(shí)客戶(hù)問(wèn)題撰寫(xiě)的，該客戶(hù)發(fā)現(xiàn)不同操作系統(tǒng)間 QoR 性能存在差異。雖然可以理解賽靈思無(wú)法保證不同操作系統(tǒng)間的可重復(fù)性，正如&qu...

2022-08-02 標(biāo)簽：Linux WINDOWS 時(shí)序 1357 0

FPGA知識(shí)匯集-源同步時(shí)序系統(tǒng)

針對(duì)普通時(shí)鐘系統(tǒng)存在著限制時(shí)鐘頻率的弊端，人們?cè)O(shè)計(jì)了一種新的時(shí)序系統(tǒng)，稱(chēng)之為源同步時(shí)序系統(tǒng)。它最大的優(yōu)點(diǎn)就是大大提升了總線(xiàn)的速度，在理論上信號(hào)的傳送可以...

2022-12-26 標(biāo)簽：fpga pcb 時(shí)序 1344 0

詳解時(shí)序路徑的相關(guān)概念

reg2reg路徑約束的對(duì)象是源寄存器（時(shí)序路徑的起點(diǎn)）和目的寄存器（時(shí)序路徑的終點(diǎn)）都在FPGA內(nèi)部的路徑。

2023-06-26 標(biāo)簽：fpga 寄存器時(shí)序 1336 0

有關(guān)FPGA的問(wèn)答集錦

FPGA做IC的原型驗(yàn)證，速度大概跑多少？很多ASIC運(yùn)行主頻遠(yuǎn)遠(yuǎn)高于FPGA，仿真能cover住嗎？

2023-06-19 標(biāo)簽：fpga 原型驗(yàn)證 lvds 1333 0

時(shí)鐘域交匯相關(guān)處理錯(cuò)誤的根本原因分析

本篇博文中的分析是根據(jù)真實(shí)客戶(hù)問(wèn)題撰寫(xiě)的，該客戶(hù)發(fā)現(xiàn)在現(xiàn)場(chǎng)出現(xiàn)罕見(jiàn)的比特翻轉(zhuǎn), 本篇博文旨在演示用于縮小根本原因范圍以及修復(fù)此問(wèn)題的部分調(diào)試技巧。

2022-08-02 標(biāo)簽：時(shí)序時(shí)鐘域 Vivado 1296 0

時(shí)序約束一主時(shí)鐘與生成時(shí)鐘

一、主時(shí)鐘create_clock 1.1 定義主時(shí)鐘是來(lái)自FPGA芯片外部的時(shí)鐘，通過(guò)時(shí)鐘輸入端口或高速收發(fā)器GT的輸出引腳進(jìn)入FPGA內(nèi)部。對(duì)于賽...

2024-11-29 標(biāo)簽：時(shí)序主時(shí)鐘 1294 0

使用Virtual Eval工具了解AD7124-4/8的時(shí)序性能

在這個(gè)演示視頻中，我們將使用Virtual Eval工具來(lái)了解AD7124-4/8的時(shí)序性能，并演示Virtual Eval工具的作用。

2023-09-07 標(biāo)簽：adc Virtual 時(shí)序 1271 0

從WasmEdge運(yùn)行環(huán)境讀寫(xiě)Rust Wasm應(yīng)用的時(shí)序數(shù)據(jù)

WebAssembly (Wasm) 正在成為一個(gè)廣受歡迎的編譯目標(biāo)，幫助開(kāi)發(fā)者構(gòu)建可遷移平臺(tái)的應(yīng)用。最近 Greptime 和 WasmEdge 協(xié)作...

2023-12-22 標(biāo)簽：時(shí)序 MySQL 編譯 1241 0

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Protues

Protues

+關(guān)注

Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

+關(guān)注

為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于A(yíng)rduino軟件下運(yùn)行，區(qū)別于A(yíng)rduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
AD10

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識(shí)別

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PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
PCB封裝庫(kù)

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QuickPcb

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Protel 99 se

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candence

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面包板

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面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
特性阻抗

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特性阻抗又稱(chēng)特征阻抗，它不是直流電阻，屬于長(zhǎng)線(xiàn)傳輸中的概念。特性阻抗是射頻傳輸線(xiàn)影響無(wú)線(xiàn)電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱(chēng)阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
Protel DXP

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庫(kù)文件

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庫(kù)文件是計(jì)算機(jī)上的一類(lèi)文件，提供給使用者一些開(kāi)箱即用的變量、函數(shù)或類(lèi)。庫(kù)文件分為靜態(tài)庫(kù)和動(dòng)態(tài)庫(kù)，靜態(tài)庫(kù)和動(dòng)態(tài)庫(kù)的區(qū)別體現(xiàn)在程序的鏈接階段：靜態(tài)庫(kù)在程序的鏈接階段被復(fù)制到了程序中；動(dòng)態(tài)庫(kù)在鏈接階段沒(méi)有被復(fù)制到程序中，而是程序在運(yùn)行時(shí)由系統(tǒng)動(dòng)態(tài)加載到內(nèi)存中供程序調(diào)用。使用動(dòng)態(tài)庫(kù)系統(tǒng)只需載入一次，不同的程序可以得到內(nèi)存中相同的動(dòng)態(tài)庫(kù)的副本，因此節(jié)省了很多內(nèi)存，而且使用動(dòng)態(tài)庫(kù)也便于模塊化更新程序。
AD軟件

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清華紫光

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Genesis2000

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Altium_Designer

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Altium Designer 是原Protel軟件開(kāi)發(fā)商Altium公司推出的一體化的電子產(chǎn)品開(kāi)發(fā)系統(tǒng)，主要運(yùn)行在Windows操作系統(tǒng)。這套軟件通過(guò)把原理圖設(shè)計(jì)、電路仿真、PCB繪制編輯、拓?fù)溥壿嬜詣?dòng)布線(xiàn)、信號(hào)完整性分析和設(shè)計(jì)輸出等技術(shù)的完美融合
敷銅板

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PCB制板

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拼接

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封裝設(shè)計(jì)

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光繪文件

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感應(yīng)式

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直角走線(xiàn)

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貼片磁珠

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導(dǎo)熱硅脂

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導(dǎo)熱硅脂俗稱(chēng)散熱膏，導(dǎo)熱硅脂以有機(jī)硅酮為主要原料，添加耐熱、導(dǎo)熱性能優(yōu)異的材料，制成的導(dǎo)熱型有機(jī)硅脂狀復(fù)合物，用于功率放大器、晶體管、電子管、CPU等電子元器件的導(dǎo)熱及散熱，從而保證電子儀器、儀表等的電氣性能的穩(wěn)定。

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