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本視頻將為您提供Model Composer的高級(jí)概述,這是一種來自Xilinx的基于模型的新設(shè)計(jì)工具,可在MathWorksSimulink?環(huán)境中快...
如何在Vivado Design Suite 中進(jìn)行IP加密
此視頻概述了Vivado Design Suite中的IP加密。 它涵蓋了IP加密工具流程,如何準(zhǔn)備加密IP以及如何在Vivado中運(yùn)行加密工具。
如何讓Vivado IP Integrator和Amazon F1開發(fā)套件進(jìn)行協(xié)同使用
歡迎閱讀本快速視頻,我將解釋如何使用Vivado IP Integrator流程與Amazon F1硬件開發(fā)套件或HDK配合使用
在醫(yī)療成像系統(tǒng)開發(fā)方面面臨的關(guān)鍵挑戰(zhàn)
在本次網(wǎng)絡(luò)研討會(huì)中,Xilinx將展示高級(jí)醫(yī)療成像系統(tǒng)開發(fā)人員面臨的關(guān)鍵挑戰(zhàn)。
在Vivado設(shè)計(jì)套件中如何執(zhí)行IO的規(guī)劃
本視頻將指您介紹如何使用Vivado設(shè)計(jì)套件中的交互式“IO Pin Planning”和“Device Exploration”功能。具體來說,IO規(guī)...
如何使用Xilinx AXI進(jìn)行驗(yàn)證和調(diào)試
了解如何使用Xilinx AXI驗(yàn)證IP有效驗(yàn)證和調(diào)試AXI接口。 該視頻回顧了使用的好處,以及如何使用示例設(shè)計(jì)進(jìn)行模擬。
歡迎閱讀有關(guān)如何將Amazon F1實(shí)例與Xilinx Ultrascale Plus FPGA配合使用的介紹性視頻。 在本練習(xí)中,我們將在一個(gè)簡單的...
增強(qiáng)現(xiàn)實(shí)的新興領(lǐng)域介紹
在本次網(wǎng)絡(luò)研討會(huì)中,Xilinx和合作伙伴Tractica將展示增強(qiáng)現(xiàn)實(shí)的新興領(lǐng)域。
如何利用C/C++編寫應(yīng)用程序加速內(nèi)核運(yùn)行
SDAccel編譯器支持OpenCL C,C和C ++,用于定義FPGA執(zhí)行的內(nèi)核功能。 了解如何利用用C / C ++編寫的現(xiàn)有函數(shù)作為FPGA上運(yùn)...
使用Vivado 2016.3中IBERT調(diào)試的好處及步驟
了解使用Vivado 2016.3中引入的系統(tǒng)內(nèi)IBERT進(jìn)行調(diào)試的好處,以及將其添加到設(shè)計(jì)中所需的步驟。
2018-11-20 標(biāo)簽:賽靈思調(diào)試設(shè)計(jì) 6015 0
Visual System Integrator的特點(diǎn)與功能介紹
System View的Visual System Integrator是一個(gè)革命性的工具,使用戶能夠在同一個(gè)直觀的圖形環(huán)境中描述平臺(tái)規(guī)范和構(gòu)建系統(tǒng)。
ICHEC討論了FPGA對(duì)HPC應(yīng)用的適用性,并重點(diǎn)介紹了能夠利用特定FPGA上所有DSP的器件的最佳數(shù)據(jù)模式。 利用Xilinx Virtex-7 ...
在Vivado中如何實(shí)現(xiàn)OpenCV設(shè)計(jì)
觀看視頻,了解OpenCV庫和其在一些典型應(yīng)用中的使用,以及Zynq-7000 SoC的優(yōu)點(diǎn)和如何實(shí)現(xiàn)OpenCV設(shè)計(jì)。同時(shí)您還能學(xué)習(xí)到如何在設(shè)計(jì)流程中...
2018-11-20 標(biāo)簽:視頻賽靈思設(shè)計(jì) 4126 0
Vivado Design Suite設(shè)計(jì)套件的UltraFast設(shè)計(jì)方法的介紹
UltraFast設(shè)計(jì)方法對(duì)您在Vivado Design Suite中的成功至關(guān)重要。 介紹UltraFast for Vivado并了解可用的材料...
2018-11-20 標(biāo)簽:賽靈思設(shè)計(jì)design 2706 0
UltraFast設(shè)計(jì)的建議方法及電路板和器件規(guī)劃介紹
介紹有關(guān)電路板和器件規(guī)劃的UltraFast設(shè)計(jì)方法建議。 本快速入門介紹了電路板布局建議,IO和時(shí)鐘規(guī)劃以及電源注意事項(xiàng)等關(guān)鍵主題。
Vivado Design Suite 2016中的新功能介紹
新的器件支持包括:Kintex?UltraScale+?,Zynq?UltraScale+ MPSoC和所有Vivado HLx版本的單核Zynq-70...
SDAccel有一個(gè)集成的調(diào)試環(huán)境(使用gdb),它提供了一個(gè)以斷點(diǎn)和單步功能為中心的軟件調(diào)試視圖。 了解如何使用集成的gdb來幫助解決功能和語法錯(cuò)誤。
AMS技術(shù)何幫助減少器件數(shù)量,提高整體系統(tǒng)性能
該視頻演示了Xilinx模擬混合信號(hào)(AMS)技術(shù)如何幫助減少器件數(shù)量,提高整體系統(tǒng)性能,并增強(qiáng)Xilinx 7系列FPGA的整體安全性,安全性和可靠性。
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