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賽靈思

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賽靈思技術

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2017-02-11 標簽:賽靈思verilogISE 3891 0

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2017-02-11 標簽:FPGA賽靈思Verilog 494 0

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編寫具有100%可靠性代碼的幾個技巧

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2017-02-11 標簽:fpga賽靈思 1327 0

賽靈思(Xilinx)FPGA用戶約束文件的分類和語法說明

FPGA設計中的約束文件有3類:用戶設計文件(.UCF文件)、網表約束文件(.NCF文件)以及物理約束文件(.PCF文件),可以完成時序約束、管腳約束以...

2017-02-11 標簽:FPGA賽靈思Xilinx 1868 0

Xilinx可編程邏輯器件設計與開發(基礎篇)連載45:Spartan

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本節將簡單介紹在PlanAhead工具中如何應用ChipScope核和分析工具進行邏輯調試與驗證。先通過一個向導將ChipScope核插入設計中,選擇待...

2017-02-11 標簽:賽靈思Xilinx可編程邏輯 895 0

Xilinx可編程邏輯器件設計與開發(基礎篇)連載44:Spartan

Xilinx可編程邏輯器件設計與開發(基礎篇)連載44:Spartan

FloorPlanning 工具是PlanAhead 的一個組成部分,用它可以對FPGA 設計進行分析,首先找到設計中的時序問題或者擁塞的問題,然后再通...

2017-02-11 標簽:賽靈思Xilinx可編程邏輯 805 0

Xilinx可編程邏輯器件設計與開發(基礎篇)連載43:Spartan

Xilinx可編程邏輯器件設計與開發(基礎篇)連載43:Spartan

在ISE 中可以進行時序分析,在PlanAhead 中同樣也可以進行時序分析。下面介紹用PlanAhead 進行時序分析的步驟。

2017-02-11 標簽:賽靈思Xilinx可編程邏輯 739 0

Xilinx可編程邏輯器件設計與開發(基礎篇)連載42:Spartan

Xilinx可編程邏輯器件設計與開發(基礎篇)連載42:Spartan

可以將綜合后網表文件導入PlanAhead,然后在PlanAhead 中完成關鍵時鐘,以及相關聯的I/O 端口的分配。

2017-02-11 標簽:賽靈思Xilinx可編程邏輯 769 0

Xilinx可編程邏輯器件設計與開發(基礎篇)連載46:Spartan

Xilinx可編程邏輯器件設計與開發(基礎篇)連載46:Spartan

我們知道,PicoBlaze微控制器只提供一個中斷輸入口,如果設計中需要多個中斷,可以在FPGA中用邏輯實現。

2017-02-11 標簽:賽靈思Xilinx可編程邏輯 527 0

Xilinx FPGA 嵌入式系統程序引導和啟動的流程

這篇blog想弄清楚FPGA上電配置后程序引導和啟動的整個流程是怎么樣的,不是談論如何編寫bootloader。

2017-02-11 標簽:FPGA賽靈思Xilinx 2502 0

Xilinx可編程邏輯器件設計與開發(基礎篇)連載50:Spartan

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1. PICOBLAZE 嵌入式系統,包括1 個8 位的方波輸出口,一個驅動兩位7 段LED 的輸出口,一個時鐘輸入和一個中斷輸入。

2017-02-11 標簽:賽靈思Xilinx可編程邏輯 788 0

Xilinx可編程邏輯器件設計與開發(基礎篇)連載49:Spartan

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通常情況下,如果對性能要求不是太高,最好是讓PicoBlaze在低頻下工作,因為它所處理的外設一般為低速設備,例如,串行通信,按鍵等。另外,低頻工作也會...

2017-02-11 標簽:賽靈思Xilinx可編程邏輯 879 0

Xilinx可編程邏輯器件設計與開發(基礎篇)連載48:Spartan

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PicoBlaze微控制器實際上包含兩個部分,分別是內核KCPSM3 和指令存儲器ROM。

2017-02-11 標簽:賽靈思Xilinx可編程邏輯 494 0

Xilinx可編程邏輯器件設計與開發(基礎篇)連載47:Spartan

Xilinx可編程邏輯器件設計與開發(基礎篇)連載47:Spartan

PicoBlaze微控制器支持最大256個輸入口和256 個輸出口,PicoBlaze與輸入和輸出有關的信號在“PicoBlaze微控制器接口信號”部分...

2017-02-11 標簽:賽靈思Xilinx可編程邏輯 438 0

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PLDA集團的990美元XpressK7 PCIe板卡,為系統設計師提供了一個基于賽靈思Kintex-7 FPGA設計或硬件原型的快速部署方法。這個主板...

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基于FPGA的低成本MIPI接口,專門針對視頻顯示器和攝像頭的。設計嵌入式系統DSI和CSI-2視頻接口的用戶現在即可采用低成本MIPI接口

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