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賽靈思

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賽靈思技術(shù)

Edge to the Cloud中的傳感器融合和智能演示

此演示突出了Edge to the Cloud中的傳感器融合和智能，以實現(xiàn)高可用性和網(wǎng)絡(luò)安全。該演示使用傳感器融合，數(shù)據(jù)庫互連和多級網(wǎng)絡(luò)安全。

2018-11-28 標(biāo)簽：傳感器賽靈思智能 4880 0

如何使用Vivado System Generator for DSP進行以太網(wǎng)硬件協(xié)同仿真

了解如何使用Vivado System Generator for DSP進行點對點以太網(wǎng)硬件協(xié)同仿真。 System Generator提供硬件協(xié)...

2018-11-23 標(biāo)簽：以太網(wǎng)賽靈思硬件 4873 0

賽靈思推出能提供FPGA設(shè)計工具和IP的ISE設(shè)計套件

賽靈思公司推出ISE設(shè)計套件11.1版本（ISE Design Suite 11.1）。這一FPGA設(shè)計解決方案在業(yè)界率先為邏輯、數(shù)字信號處理、嵌入式處...

2018-10-27 標(biāo)簽：fpga 賽靈思數(shù)字信號 4855 0

PCIe x8 Gen3在Xilinx Kintex-7 FPGA KC705板上的運行演示

演示運行x8 Gen3 PCI Express Link的Xilinx Kintex-7 FPGA KC705板。

2019-01-04 標(biāo)簽：fpga 存儲器賽靈思 4853 0

NGCodec H.265/HEVC視頻壓縮技術(shù)介紹

NGCodec開發(fā)下一代視頻壓縮技術(shù)，專為超低延時，高質(zhì)量應(yīng)用而優(yōu)化使用Xilinx FPGA，NGCodec可以硬件加速其HEVC / H.265算法...

2018-11-22 標(biāo)簽：fpga 視頻賽靈思 4847 0

Virtex-7 FPGA系列的內(nèi)存控制器介紹

本視頻介紹了可用于構(gòu)建7系列FPGA內(nèi)存控制器的軟IP。這些模塊討論了如何使用Xilinx存儲器接口生成器構(gòu)建存儲器控制器以及MIG如何構(gòu)建存儲器控制器。

2018-11-22 標(biāo)簽：控制器存儲器賽靈思 4840 0

Xilinx FSBL如何操作啟動Zynq器件

了解Xilinx FSBL如何操作以啟動Zynq器件。包括程序執(zhí)行概述，調(diào)試技巧以及有關(guān)特定引導(dǎo)設(shè)備的信息。還包括FSBL角度的啟動安全性簡要概述。

2018-11-23 標(biāo)簽：賽靈思調(diào)試 zynq 4828 0

Xilinx DPD 解決方案使用經(jīng)驗（四）

Xilinx DPD 解決方案的Microblaze每執(zhí)行一次Control_mode(通俗的講，就是命令)，都會返回一個CommandStatus.

2017-02-11 標(biāo)簽：賽靈思 Xilinx DPD 4821 1

Xilinx 16nm UltraScale+系列產(chǎn)品的發(fā)布

賽靈思率先發(fā)布業(yè)界首款16nm產(chǎn)品，Xilinx 16nm UltraScale +系列產(chǎn)品（FPGA，3D IC和MPSoC）結(jié)合了全新的內(nèi)存，3D-...

2018-11-22 標(biāo)簽：fpga 賽靈思 adas 4816 0

Xilinx Zynq SOC的動態(tài)電源管理功能的展示

此Zynq低功耗模式（LPM）演示討論并展示了Xilinx Zynq SOC的動態(tài)電源管理功能的實例。 LPM演示清楚地顯示了Zynq SOC在提供...

2018-11-29 標(biāo)簽：電源管理賽靈思 soc 4796 0

為何要選擇Zynq-7000 All Programmable SoC

Zynq-7000 AP SoC作為業(yè)界第一款SoC產(chǎn)品，完美集成了雙核ARM Cortex-A9處理器與賽靈思28 nm FPGA。本視頻向您展示了Z...

2018-06-05 標(biāo)簽：arm 賽靈思 soc 4794 0

如何運行內(nèi)存接口生成器GUI以生成RTL

通過使用流量生成器創(chuàng)建示例設(shè)計，運行綜合和實現(xiàn)以及查看摘要報告（利用率，功率等），了解如何運行內(nèi)存接口生成器（MIG）GUI以生成RTL和約束文件

2018-11-23 標(biāo)簽：賽靈思內(nèi)存 rtl 4793 0

Vivado 2015.3的新增量編譯功能

了解Vivado實現(xiàn)中2015.3中的新增量編譯功能，包括更好地處理物理優(yōu)化和自動增量編譯流程。

2018-11-30 標(biāo)簽：賽靈思優(yōu)化 vivado 4767 0

如何使用IP Integrator創(chuàng)建硬件設(shè)計

本視頻介紹了使用IP Integrator（IPI）創(chuàng)建簡單硬件設(shè)計的過程。使用IPI可以無縫，快速地實現(xiàn)DDR4和PCIe等塊連接在一起，在幾...

2018-11-22 標(biāo)簽：賽靈思 ip pcie 4730 0

如何使用Vivado在設(shè)備啟動時進行調(diào)試

了解如何使用Vivado在設(shè)備啟動時及其周??圍進行調(diào)試。你也會學(xué)習(xí) 使用Vivado 2014.1中引入的Trigger at Startup功...

2018-11-22 標(biāo)簽：賽靈思設(shè)備調(diào)試 4726 0

賽靈思FPGA DIY系列（5）：中頻全數(shù)字頻譜分析儀的實現(xiàn)

本設(shè)計主要完成了中頻全數(shù)字頻譜分析儀的FPGA設(shè)計與實現(xiàn)。設(shè)計是在Xilinx的Spartan6系列xc6slx16-3csg324型號的FPGA芯片中...

2013-04-15 標(biāo)簽：DSP FPGA 濾波器 4690 0

賽靈思器件低端產(chǎn)品組合中三大器件系列給DSP設(shè)計師提供了選擇

除了提供基礎(chǔ)的GMAC性能，把這些高性價比低端All Programmable器件用于DSP應(yīng)用的另外一個優(yōu)勢是實際的能效優(yōu)勢。

2019-07-23 標(biāo)簽：dsp ti 賽靈思 4677 0

賽靈思UltraScale架構(gòu)：業(yè)界首款A(yù)SIC級All Programmable架構(gòu)

UltraScale? 架構(gòu)通過在完全可編程的架構(gòu)中應(yīng)用最先進的ASIC 技術(shù)，可應(yīng)對上述這些挑戰(zhàn)。該架構(gòu)能從20nm平面FET結(jié)構(gòu)擴展至16nm鰭式F...

2013-07-09 標(biāo)簽：FPGA ASIC 賽靈思 4666 0

如何設(shè)置CTLE模擬以優(yōu)化接收器眼圖開度

了解UltraScale IO中新的連續(xù)時間線性均衡器（CTLE）如何幫助設(shè)計DDR4和SGMII等高速接口。您還將學(xué)習(xí)如何設(shè)置CTLE模擬以優(yōu)化接...

2018-11-28 標(biāo)簽：接收器賽靈思優(yōu)化 4663 0

賽靈思Kintex-7低功耗演示

賽靈思7系列FPGA產(chǎn)品通過采用新的工藝和新的架構(gòu)方式，成功將產(chǎn)品的功耗顯著降低。7系列FPGA產(chǎn)品的實測功耗與上一代產(chǎn)品相比，降低了約一半。采用臺積電...

2018-06-05 標(biāo)簽：fpga 賽靈思 Xilinx 4655 0

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