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如何減少內(nèi)存模型調(diào)試時(shí)間

星星科技指導(dǎo)員 ? 來(lái)源:synopsys ? 作者:synopsys ? 2023-05-26 10:30 ? 次閱讀
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正在尋找縮短調(diào)試周期的方法,以快速?gòu)母旧辖鉀Q內(nèi)存控制器/PHY 和子系統(tǒng)驗(yàn)證項(xiàng)目中的問題?

在某些時(shí)候,您在調(diào)試內(nèi)存模型時(shí)很可能面臨以下挑戰(zhàn)之一(計(jì)時(shí)問題、日志消息、銀行統(tǒng)計(jì)信息、分層調(diào)試等)。

Synopsys 內(nèi)存模型 (VIP) 與 Verdi 一起可提高整體調(diào)試效率。以下是緊密耦合的調(diào)試解決方案如何幫助解決一些痛點(diǎn)的示例:

以協(xié)議為中心的調(diào)試使用戶能夠快速了解協(xié)議活動(dòng),識(shí)別瓶頸并快速查找和調(diào)試意外行為

協(xié)議視圖中的錯(cuò)誤、警告和消息注釋可快速確定原因

交易、銀行狀態(tài)、內(nèi)存內(nèi)容和握手的圖形視圖,可立即訪問特定于上下文的詳細(xì)信息

鎖定步驟鏈接到模擬器跟蹤視圖(波形),可在任何抽象級(jí)別輕松調(diào)試

以下是其他示例,其中包含詳細(xì)說(shuō)明供您參考:

協(xié)議和計(jì)時(shí)沖突: 當(dāng)內(nèi)存VIP檢測(cè)到協(xié)議/時(shí)序沖突時(shí),通知將顯示有關(guān)被破壞的規(guī)范部分的所有命令性信息,包括報(bào)告錯(cuò)誤的組件,協(xié)議版本以及針對(duì)預(yù)期的規(guī)范定義值應(yīng)采取的糾正措施。

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跟蹤文件: 跟蹤是特殊的文本文件,其中包含有用的信息,例如事務(wù)的開始/結(jié)束時(shí)間和命令名稱等。例如,如果命令是“模式寄存器”,則會(huì)顯示與“模式寄存器”字段相關(guān)的所有信息,例如讀/寫命令、相關(guān)地址、數(shù)據(jù)和重要信息,如延遲、DBI、DM 和模式寄存器設(shè)置。

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調(diào)試端口:它們?cè)诟叨瘸橄笾刑峁┝藚f(xié)議流量的可視化表示,例如在哪個(gè)銀行執(zhí)行交易、編程模式寄存器值、銀行狀態(tài)、命令和數(shù)據(jù) ID 標(biāo)記以將數(shù)據(jù)與相應(yīng)的命令相關(guān)聯(lián),以及其他功能。調(diào)試端口作為 Synopsys 內(nèi)存 VIP 接口的一部分提供,并可加載到波形查看器(如 Verdi)上。

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威爾第協(xié)議分析器流程:這提供了交易、銀行狀態(tài)、內(nèi)存內(nèi)容的配置設(shè)置、模擬等的圖形可視化。通過同步視圖,用戶只需單擊ERROR消息,相應(yīng)的牽引,內(nèi)存地址位置和信號(hào)電平流量信息等詳細(xì)信息將突出顯示給用戶。

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Synopsys Memory VIP 獨(dú)特、靈活的架構(gòu)使其可以輕松插入任何基于 Verilog/SV/UVM/VMM 的測(cè)試平臺(tái)設(shè)置。

審核編輯:郭婷

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