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gate_en信號(hào)中的clock gating有什么用呢?

全棧芯片工程師 ? 來(lái)源:全棧芯片工程師 ? 2023-10-16 09:55 ? 次閱讀
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直接上硬菜,請(qǐng)問下面電路什么功能?

畫出電路、畫出波形,設(shè)計(jì)意圖一目了然,筆者一直推薦這種設(shè)計(jì)方案風(fēng)格,畫出電路圖、波形圖絕對(duì)是設(shè)計(jì)輔助利器。

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同學(xué)問,這個(gè)gate_en信號(hào)就已經(jīng)是一個(gè)三分頻信號(hào)了,圖中這個(gè)clock gating 有什么用呢?

答:這個(gè)在景芯SoC培訓(xùn)里面專門講過,雖然是三分頻但是畢竟不是clock,只是reg的輸出,驅(qū)動(dòng)力不足,很少用這種三分頻的信號(hào)去作為clock采數(shù)據(jù)。所以分頻信號(hào)當(dāng)EN信號(hào)用,接ICG的EN。

問:netlist flow第一步插mbist的時(shí)候報(bào)錯(cuò)說:

dft_cell_selection wrapper doesn't contain an entry for cell_type 'PosedgeSynchronizerReset',工藝庫(kù)里面是沒有這種cell的,這種情況該怎么處理?

e9c7954c-6a67-11ee-939d-92fbcf53809c.png

缺上升沿復(fù)位的同步器,如命令提示,我們直接將use_rtl_synchronizer_cell設(shè)置為on,默認(rèn)是auto。

use_rtl_synchronizer_cell on

另外注意:

use_synchronizer_cell_with_reset on ,這個(gè)命令默認(rèn)是on。

那么請(qǐng)問,netlist flow為何use_rtl_synchronizer_cell設(shè)置為auto就不行?

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審核編輯:劉清

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原文標(biāo)題:全流程學(xué)習(xí)SoC芯片設(shè)計(jì)【今日問題】

文章出處:【微信號(hào):全棧芯片工程師,微信公眾號(hào):全棧芯片工程師】歡迎添加關(guān)注!文章轉(zhuǎn)載請(qǐng)注明出處。

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