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電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>用多片FPGA進行ASIC設計驗證的分區和綜合技術

用多片FPGA進行ASIC設計驗證的分區和綜合技術

2009-11-24 | rar | 225 | 次下載 | 5積分

資料介紹

在現在復雜的ASIC 設計中,校驗(Verification)是最大的瓶頸。隨著先進的半導體工藝技術不斷前進,隨之帶來的是ASIC 設計規模和設計復雜度的飛速增長,這使得傳統的軟件仿真工具已經無法完全解決驗證的問題。而且隨著越來越多的需要處理大量實時數據的應用(如視頻)出現,驗證技術就要求能夠在接近實時頻率的條件下進行驗證。現在越來越多的ASIC 設計者自己設計FPGA 驗證板來進行ASIC 設計驗證。用FPGA 驗證ASIC 的好處是可以使軟件的開發調試和ASIC 的開發調試并行的進行。
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