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電子系統設計人員使用FPGA來實現他們的原型開發，利用器件的可編程能力驗證硬件和軟件。一旦設計準備好進行量產時，設計人員尋找某類ASIC以達到功耗、性能和成本目標，特別是，能夠提供硬件平臺和工具包的ASIC，支持目前采用了FPGA的設計，可以使用相同的I/O、存儲器資源和IP。依據這些標準，設計人員降低了ASIC設計出現功能或者時序錯誤的風險。本文討論Altera HardCopy ASIC的發展、體系結構和功能，它作為封裝和引腳兼容FPGA匹配器件，非常適合實現設計量產。
HardCopy體系結構的一個重要特性是其功耗低于FPGA原型。由于HardCopy ASIC采用了陣列/直接連線體系結構，有效地降低了邏輯實現所需要的晶體管數量，因此，功耗要遠遠低于LUT/交換架構。而且，HardCopy ASIC也不需要FPGA重新編程所使用的大量內部配置RAM空間。由于HardCopy ASIC只用于一種功能，基本器件中消耗功率的資源連接至電源分配網絡，而未使用的器件資源沒有連接到這一網絡上。總體上，HardCopy ASIC功耗比對應的FPGA原型低50％。從FPGA原型到HardCopy ASIC實際降低的功耗取決于使用的邏輯和其他資源之比，例如內部存儲器和I/O等，這些資源不會降低功耗，所占的比例與FPGA原型相同。
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