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文章目錄1、時(shí)鐘約束的概念2、 DC中的時(shí)序約束參考文章時(shí)間又拖拖拖,隨著追尋DFT的進(jìn)度,DC的進(jìn)度在經(jīng)歷了.dynopsys_dc.setup后,就停滯不前了,接下來(lái)本文就來(lái)介紹DC的約束篇目,在我理解來(lái)看vcs是不帶時(shí)序信息的,而DC就是盡量滿足符合實(shí)際工作環(huán)境來(lái)建立一個(gè)數(shù)字電路的模型,也就是說(shuō)他會(huì)盡量的接近實(shí)際的工作環(huán)境來(lái)建立模型。所以約束,就有用了,不僅僅是環(huán)境約束,告訴DC綜合出來(lái)的芯片要工作在什么環(huán)境下面等等。1、時(shí)鐘約束的概念我們必須定義時(shí)鐘周期(也就是-period這個(gè)選項(xiàng))和時(shí)鐘源
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